Meta Iris의 공정 노드는 과도하게 추측되는 주제입니다. 2026년 7월 31일 기준 보도에 따르면 Iris는 TSMC가 제조하고 Broadcom이 설계를 지원하지만, 나노미터 공정, 소비 전력, HBM 용량은 신뢰할 수 있는 공개 확인이 없습니다. 이 글은 확정된 파트너 정보와 미확인 사양을 구분합니다.
「몇 나노인가」「TSMC 파운드리인가」를 검색하는 독자는 완성된 사양표를 원하는 경우가 많습니다. 그러나 파트너 발표와 사양 공개는 별개입니다. Broadcom과의 협력 확대, TSMC 제조 보도는 인용 가능한 사실이지만, 구체적 공정 노드는 현재로서는 방향성 추론에 그칩니다.
1Iris의 공정 노드가 공개됐는가?
집필 시점 기준, Iris의 구체적 공정 노드를 확인한 신뢰할 수 있는 공개 출처는 없습니다. 2026년 7월 Reuters 보도는 Iris가 TSMC 제조이며 Broadcom이 설계를 지원한다고 전했지만, 3nm·5nm 등의 노드는 밝히지 않았습니다. Meta의 2026년 4월 Broadcom 협력 확대와 3월 chiplet 로드맵은 아키텍처 방향과 공급망 역할을 설명할 뿐, Iris 전체 하드웨어 사양 공개와는 다릅니다.
⚠️ 사실 경계: 「TSMC 제조」는 파운드리를 특정하는 것이지, 나노미터 공정 확정이 아닙니다. 공급망 루머를 사양표로 바꾼 기사가 이 주제에서 가장 흔한 왜곡입니다.
Broadcom 설계 협력
소비 전력·코어 규모
저정밀·인터커넥트
2TSMC 파운드리가 의미하는 것과 그렇지 않은 것
TSMC를 선택했다는 것은 Iris가 선단 공정 라인, CoWoS급 패키징, AI 가속기 파운드리 경험을 활용할 가능성을 시사합니다——대규모 배포의 예측 가능성을 뒷받침하는 요소입니다. 다만 파운드리 선택이 특정 노드, 다이당 소비 전력 상한, 카드당 메모리 용량을 자동으로 의미하지는 않습니다.
💡 핵심 관찰: 대규모 배포는 단일 나노미터 수치보다 패키징 생산 능력, HBM 공급, 랙 간 인터커넥트에 더 좌우될 수 있습니다.
3Broadcom 설계 협력에서 기대할 수 있는 것
Broadcom의 역할은 커스텀 칩 설계 협력이며, 파운드리 제조가 아닙니다. 데이터센터 네트워킹, SerDes, ASIC 납품 경험은 Iris의 인터커넥트와 시스템 통합을 형성할 가능성이 있으며, 추천·광고·생성 AI 워크로드로 Iris를 확장 배포할 수 있는지에 직결됩니다. 트랜지스터 수와 피크 연산 성능 수치는 여전히 알려지지 않았습니다.
| 정보 유형 | 현재 상태 | 해석 방법 |
|---|---|---|
| 파운드리 | TSMC (언론 보도) | 제조·패키징 역량 기대 |
| 설계 파트너 | Broadcom (공식 협력 확대) | 커스텀 ASIC·인터커넥트 전문성 |
| 공정 노드 | 공개 미확인 | 미검증 「nm」 주장은 인용하지 말 것 |
| MTIA 300–500 지표 | 일부 방향성만 공개 | Iris 전체 사양과 동일하지 않음 |
4MTIA 로드맵에서 읽을 수 있는 기술 방향
Meta의 MTIA 노선은 모듈형 chiplet, 짧은 반복 주기, PyTorch 네이티브 지원, 저정밀 추론 데이터 타입을 강조합니다. MTIA 300–500 지표는 맥락을 제공하지만, Iris 사양의 확정 정보는 아닙니다.
- 모듈형 chiplet — 워크로드별로 연산과 메모리를 분리할 가능성이 있습니다. 다이 수·대역폭은 아직 미확인입니다.
- HBM — 추론 워크로드는 높은 대역폭이 필요합니다. Iris는 HBM 적층을 중시할 가능성이 있으나, 용량 수치는 공개를 기다려야 합니다.
- 저정밀·PyTorch — FP8/INT8 경로로 효율 향상이 가능할 수 있습니다. 합리적 추론이지, Iris 확정 파라미터는 아닙니다.
- 랙 수준 인터커넥트 — 대규모 배포에는 다중 카드 네트워킹이 필요합니다. 프로토콜·규모는 아직 공개되지 않았습니다.
5확정으로 쓰면 안 되는 사양
Meta 공식 발표나 Hot Chips / ISCA 공개가 없는 한, 공정 노드, TDP, 피크 FLOPS, HBM 용량, 가격, 양산 시기를 확정 사항으로 쓰면 안 됩니다. 확정(파운드리·설계 파트너·MTIA 방향성), 추론 가능(chiplet·HBM·저정밀), 불명(노드·소비 전력·연산·가격)의 세 층으로 정리하고, 「가능성」「아직 미확인」 표현을 유지하세요.
6향후 검증 포인트
Iris의 공정 노드는 언제 확정될 수 있을까?
Meta 엔지니어링 블로그, 학술 논문, Hot Chips / ISCA 자료를 주시하세요. Reuters나 Bloomberg가 이차 확인한 공개 이후에야 「확정」으로 격상할 수 있습니다.
TSMC 제조가 최첨단 노드를 보장하나?
반드시 그렇지는 않습니다. 파운드리는 여러 노드를 제공하며, 제품은 성능·비용·생산 능력 사이에서 트레이드오프합니다. 「TSMC」는 「최신 nm」과 동의어가 아닙니다.
Broadcom이 파운드리인가?
아닙니다. Broadcom은 설계 협력을 담당하고, TSMC가 웨이퍼를 제조합니다. 두 역할을 혼동하지 마세요.
2026년 7월 31일 기준, Iris의 파운드리와 설계 파트너는 보도됐지만 공정 노드에 대한 신뢰할 수 있는 공개 확인은 없습니다. TSMC는 제조 역량, Broadcom은 ASIC·인터커넥트 전문성을 시사합니다. chiplet, HBM, 저정밀은 주목할 영역이지, 확정 사양표가 아닙니다.
- 1확정 파트너와 미확인 공정 노드를 분리하기
- 2MTIA 로드맵에서 추론하되, MTIA 300–500 지표를 Iris 전체 사양과 동일시하지 않기
- 3Meta 공식 공개와 권위 있는 언론을 추적하고, 조작된 사양 쌓기를 피하기
7AI 칩 동향을 추적하며 로컬 개발하기
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